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电子技术基础 数字部分（第六版）

“十二五”普通高等教育本科国家级规划教材
样章
作者：
康华光
定价：
59.90元
ISBN：
978-7-04-038004-0
版面字数：
820.000千字
开本：
16开
全书页数：
552页
装帧形式：
平装
重点项目：
“十二五”普通高等教育本科国家级规划教材
出版时间：
2014-01-02
读者对象：
高等教育
一级分类：
电气/电子信息/自动化类
二级分类：
电子电气类核心课程
三级分类：
数字电子技术

本书被评为“十二五”普通高等教育本科国家级规划教材｡上一版为普通高等教育“十五”国家级规划教材,第四版为面向21世纪课程教材,荣获2002年全国普通高等学校优秀教材一等奖｡

本次修订弱化了中规模集成芯片的应用,将组合与时序单元电路作为宏模型介绍,加强应用FPGA､CPLD进行数字系统设计的内容｡加强低电源电压器件及其接口内容,消减TTL系列的内容｡增加CMOS通用电路中小逻辑与宽总线内容的介绍｡加强应用Verilog语言描述组合及时序单元电路的例题｡

全书共11章,分别是:数字逻辑概论,逻辑代数与硬件描述语言基础,逻辑门电路,组合逻辑电路,锁存器和触发器,时序逻辑电路,半导体存储器,CPLD和FPGA,脉冲波形的变换与产生,数模与模数转换器,数字系统设计基础｡附录中列出EDA工具Quartus Ⅱ 9.0简介,电气简图用图形符号二进制逻辑单元(GB/T 4728.12—1996)简介,常用逻辑符号对照表｡

本书可作为高等学校电气类､电子信息类､自动化类等专业“数字电子技术基础”课程的教材,也可供相关工程技术人员参考｡

  • 前辅文
  • 1 数字逻辑概论
    • 1.1 数字信号与数字电路
      • 1.1.1 数字技术的发展及其应用
      • 1.1.2 数字集成电路的分类及特点
      • 1.1.3 模拟信号和数字信号
      • 1.1.4 数字信号的描述方法
    • 1.2 数制
      • 1.2.1 十进制
      • 1.2.2 二进制
      • 1.2.3 十-二进制之间的转换
      • 1.2.4 十六进制和八进制
    • 1.3 二进制数的算术运算
      • 1.3.1 无符号二进制数的算术运算
      • 1.3.2 带符号二进制数的减法运算
    • 1.4 二进制代码
      • 1.4.1 二-十进制码
      • 1.4.2 格雷码
      • 1.4.3 ASCII码
    • 1.5 二值逻辑变量与基本逻辑运算
    • 1.6 逻辑函数及其表示方法
      • 1.6.1 逻辑函数的几种表示方法
      • 1.6.2 逻辑函数表示方法之间的转换
    • 小 结
    • 习 题
  • 2 逻辑代数与硬件描述语言基础
    • 2.1 逻辑代数的基本定律和规则
      • 2.1.1 逻辑代数的基本定律和恒等式
      • 2.1.2 逻辑代数的基本规则
    • 2.2 逻辑函数表达式的形式
      • 2.2.1 逻辑函数表达式的基本形式
      • 2.2.2 最小项与最小项表达式
      • 2.2.3 最大项与最大项表达式
    • 2.3 逻辑函数的代数化简法
      • 2.3.1 逻辑函数的最简形式
      • 2.3.2 逻辑函数的代数化简法
    • 2.4 逻辑函数的卡诺图化简法
      • 2.4.1 用卡诺图表示逻辑函数
      • 2.4.2 用卡诺图化简逻辑函数
    • 2.5 硬件描述语言Verilog HDL基础
      • 2.5.1 Verilog语言的基本语法规则
      • 2.5.2 变量的数据类型
      • 2.5.3 运算符及其优先级
      • 2.5.4 Verilog内部的基本门级元件
      • 2.5.5 Verilog程序的基本结构
      • 2.5.6 逻辑功能的仿真与测试
    • 小 结
    • 习 题
  • 3 逻辑门电路
    • 3.1 逻辑门电路简介
      • 3.1.1 各种逻辑门电路系列简介
      • 3.1.2 开关电路
    • 3.2 基本CMOS逻辑门电路
      • 3.2.1 MOS管及其开关特性
      • 3.2.2 CMOS反相器
      • 3.2.3 其他基本CMOS逻辑门电路
      • 3.2.4 CMOS传输门
    • 3.3 CMOS逻辑门电路的不同输出结构及参数
      • 3.3.1 CMOS逻辑门的保护和缓冲电路
      • 3.3.2 CMOS漏极开路门和三态输出门电路
      • 3.3.3 CMOS逻辑门电路的重要技术参数
    • 3.4 类NMOS和BiCMOS逻辑门电路
      • 3.4.1 类NMOS门电路
      • 3.4.2 BiCMOS门电路
    • 3.5 TTL逻辑门电路
      • 3.5.1 BJT的开关特性
      • 3.5.2 TTL反相器的基本电路
      • 3.5.3 改进型TTL门电路——抗饱和TTL门电路
      • 3.5.4 TTL系列门电路特性参数比较
    • *3.6 ECL逻辑门电路
    • 3.7 逻辑描述中的几个问题
      • 3.7.1 正负逻辑问题
      • 3.7.2 基本逻辑门的等效符号及其应用
    • 3.8 逻辑门电路使用中的几个实际问题
      • 3.8.1 各系列逻辑门电路之间的接口问题
      • 3.8.2 逻辑门电路驱动其他负载时的接口
      • 3.8.3 抗干扰措施
      • 3.8.4 CMOS通用逻辑电路中的小尺寸逻辑和宽总线系列
    • 3.9 用Verilog HDL描述CMOS门电路
      • 3.9.1 CMOS门电路的Verilog建模
      • 3.9.2 CMOS传输门电路的Verilog建模
    • 小 结
    • 习 题
  • 4 组合逻辑电路
    • 4.1 组合逻辑电路的分析
      • 4.1.1 组合逻辑电路的定义
      • 4.1.2 组合逻辑电路的分析方法
    • 4.2 组合逻辑电路的设计
      • 4.2.1 组合逻辑电路的设计过程
      • 4.2.2 组合逻辑电路的优化实现
    • 4.3 组合逻辑电路中的竞争-冒险
      • 4.3.1 产生竞争-冒险的原因
      • 4.3.2 消去竞争-冒险的方法
    • 4.4 若干典型的组合逻辑电路
      • 4.4.1 编码器
      • 4.4.2 译码器/数据分配器
      • 4.4.3 数据选择器
      • 4.4.4 数值比较器
      • 4.4.5 算术运算电路
    • 4.5 组合可编程逻辑器件
      • 4.5.1 PLD的结构､表示方法及分类
      • 4.5.2 组合逻辑电路的PLD实现
    • 4.6 用Verilog HDL描述组合逻辑电路
      • 4.6.1 组合逻辑电路的行为级建模
      • 4.6.2 分模块､分层次的电路设计
    • 小 结
    • 习 题
  • 5 锁存器和触发器
    • 5.1 基本双稳态电路
      • 5.1.1 双稳态的概念
      • 5.1.2 最基本的双稳态电路
    • 5.2 SR锁存器
      • 5.2.1 基本SR锁存器
      • 5.2.2 门控SR锁存器
    • 5.3 D锁存器
      • 5.3.1 D锁存器的电路结构
      • 5.3.2 典型的D锁存器集成电路
      • 5.3.3 D锁存器的动态特性
    • 5.4 触发器的电路结构和工作原理
      • 5.4.1 主从D触发器的电路结构和工作原理
      • 5.4.2 典型的主从D触发器集成电路
      • 5.4.3 主从D触发器的动态特性
      • 5.4.4 其他电路结构的触发器
    • 5.5 触发器的逻辑功能
      • 5.5.1 D触发器
      • 5.5.2 JK触发器
      • 5.5.3 T触发器
      • 5.5.4 SR触发器
      • 5.5.5 D触发器逻辑功能的转换
    • 5.6 用Verilog HDL描述锁存器和触发器
      • 5.6.1 时序逻辑电路建模基础
      • 5.6.2 锁存器和触发器的Verilog建模实例
    • 小 结
    • 习 题
  • 6 时序逻辑电路
    • 6.1 时序逻辑电路的基本概念
      • 6.1.1 时序逻辑电路的基本结构与分类
      • 6.1.2 时序逻辑电路功能的表达
    • 6.2 同步时序逻辑电路的分析
      • 6.2.1 分析同步时序逻辑电路的一般步骤
      • 6.2.2 同步时序逻辑电路分析举例
    • 6.3 同步时序逻辑电路的设计
      • 6.3.1 设计同步时序逻辑电路的一般步骤
      • 6.3.2 同步时序逻辑电路设计举例
      • 6.3.3 同步时序逻辑电路中的时钟偏移
    • 6.4 异步时序逻辑电路的分析
    • 6.5 若干典型的时序逻辑电路
      • 6.5.1 寄存器和移位寄存器
      • 6.5.2 计数器
    • 6.6 简单的时序可编程逻辑器件GAL
      • 6.6.1 GAL的结构
      • 6.6.2 GAL中的输出逻辑宏单元
      • 6.6.3 GAL的结构控制字
    • 6.7 用Verilog HDL描述时序逻辑电路
      • 6.7.1 移位寄存器的Verilog建模
      • 6.7.2 计数器的Verilog建模
      • 6.7.3 状态图的Verilog建模
      • 6.7.4 数字钟的Verilog建模
    • 小 结
    • 习 题
  • 7 半导体存储器
    • 7.1 只读存储器
      • 7.1.1 ROM的基本结构
      • 7.1.2 二维译码与存储阵列
      • 7.1.3 可编程ROM
      • 7.1.4 ROM读操作实例
      • 7.1.5 ROM应用举例
    • 7.2 随机存取存储器
      • 7.2.1 SRAM
      • 7.2.2 同步SRAM
      • 7.2.3 DRAM
      • 7.2.4 存储容量的扩展
      • 7.2.5 RAM应用举例
    • 小 结
    • 习 题
  • 8 CPLD和FPGA
    • 8.1 复杂可编程逻辑器件(CPLD)简介
    • 8.2 现场可编程门阵列(FPGA)
      • 8.2.1 FPGA中编程实现逻辑功能的基本原理
      • 8.2.2 FPGA的结构简介
    • 8.3 可编程逻辑器件开发过程简介
    • 8.4 用EDA技术和可编程器件的设计例题
    • 小 结
    • 习 题
  • 9 脉冲波形的变换与产生
    • 9.1 单稳态触发器
      • 9.1.1 用门电路组成的单稳态触发器
      • 9.1.2 集成单稳态触发器
      • 9.1.3 单稳态触发器的应用
    • 9.2 施密特触发器
      • 9.2.1 用门电路组成的施密特触发器
      • 9.2.2 集成施密特触发器
      • 9.2.3 施密特触发器的应用
    • 9.3 多谐振荡器
      • 9.3.1 门电路组成的多谐振荡器
      • 9.3.2 用施密特触发器构成多谐振荡器
      • 9.3.3 石英晶体多谐振荡器
    • 9.4 555定时器及其应用
      • 9.4.1 555定时器
      • 9.4.2 用555组成的施密特触发器
      • 9.4.3 用555组成的单稳态触发器
      • 9.4.4 用555组成的多谐振荡器
    • 小 结
    • 习 题
  • 10 数模与模数转换器
    • 10.1 D/A转换器
      • 10.1.1 D/A转换器的输入/输出特性及其结构框图
      • 10.1.2 D/A转换器的基本原理
      • 10.1.3 倒T形电阻网络D/A转换器
      • 10.1.4 权电流型D/A转换器
      • *10.1.5 权电容网络D/A转换器
      • 10.1.6 D/A转换器的输出方式
      • 10.1.7 D/A转换器的主要技术指标
      • 10.1.8 D/A转换器的应用
    • 10.2 A/D转换器
      • 10.2.1 A/D转换的一般工作过程
      • 10.2.2 并行比较型A/D转换器
      • 10.2.3 逐次比较型A/D转换器
      • 10.2.4 双积分式A/D转换器
      • 10.2.5 A/D转换器的主要技术指标
      • 10.2.6 集成A/D转换器及其应用
    • 小 结
    • 习 题
  • *11 数字系统设计基础
    • 11.1 数字系统概述
      • 11.1.1 数字系统的组成
      • 11.1.2 数字系统的设计方法
      • 11.1.3 数字系统的实现
    • 11.2 算法状态机
      • 11.2.1 ASM图形符号
      • 11.2.2 ASM图与状态图
    • 11.3 交通信号灯控制系统
      • 11.3.1 交通信号灯控制系统ASM图
      • 11.3.2 用典型电路基本模块实现交通灯控制系统
      • 11.3.3 用可编程逻辑器件实现交通灯控制系统
    • 11.4 数字密码锁
      • 11.4.1 数字密码锁的ASM图
      • 11.4.2 用典型电路基本模块实现数字密码锁
      • 11.4.3 用可编程逻辑器件实现数字密码锁
    • 小 结
    • 习 题
  • 附录A EDA工具Quartus Ⅱ 9.0简介
    • A.1 Quartus Ⅱ 9.0软件主界面
    • A.2 Quartus Ⅱ的设计流程
    • A.3 设计与仿真的过程
      • A.3.1 建立新的设计项目
      • A.3.2 输入设计文件
      • A.3.3 编译设计文件
      • A.3.4 设计项目的仿真验证
    • A.4 引脚分配与器件编程
      • A.4.1 引脚分配
      • A.4.2 对目标器件编程
  • 附录B 电气简图用图形符号——二进制逻辑单元(GB/T 4728.12—1996)简介
    • B.1 二进制逻辑单元图形符号的组成
    • B.2 限定性符号
    • B.3 关联标注法
  • 附录C 常用逻辑符号对照表
  • 部分习题答案
  • 索引(汉英对照)
  • 参考文献

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